{ "item_title" : "Performance et analyse de l'exécution hors ordre des tâches dans les MPSoCs", "item_author" : [" Arun Prasath R.", "Ganesh Kumar P. "], "item_description" : "La structure de communication inter-sous-syst mes peuttre optimis e au d but du processus de conception en utilisant des mod les de simulationtrois niveaux d'abstraction diff rents. Cette m thode d'exploration permet d' viter certains cas de boucles de conception. Avec l' tude de cas Motion-JPEG, nous illustrons l'ensemble du processus d'exploration de la communicationtape partape. Les r sultats exp rimentaux montrent que, par rapportla simulation pr cise du cycle, la communication inter-syst mes peuttre bien optimis e etvalu edes niveaux d'abstraction pluslev s. Dans ce projet, une solution pour un probl me de classification est utilis e pour optimiser l'affectation des paquetsdiff rents chemins de donn es au sein d'un syst me sur puce (SoC) de processeur de r seau. Sur la base d'une sp cification du cas d'utilisation de notre classificateur, il d rive l'algorithme de graphe de d cision h t rog ne (HDGA), une approche heuristique pour construire un classificateur d'arbre de d cision qui int gre des r sultats de recherche externes pour certains types de r gles.valuation de divers param tres pour optimiser l'arbre de d cision proposet pr sentation de r sultats de simulation pour montrer l' volutivitde l'HDGA pour des tailles de probl mes typiques. Ce projet se termine par les r sultats d'une impl mentation sur notre plateforme FPGA.", "item_img_path" : "https://covers4.booksamillion.com/covers/bam/6/20/835/382/6208353823_b.jpg", "price_data" : { "retail_price" : "42.00", "online_price" : "42.00", "our_price" : "42.00", "club_price" : "42.00", "savings_pct" : "0", "savings_amt" : "0.00", "club_savings_pct" : "0", "club_savings_amt" : "0.00", "discount_pct" : "10", "store_price" : "" } }

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